Processador Intel Alder Lake (12th gen) - 120xxk & Z690 lançados

E agora algo "novo"

Early Intel 8-core/16-thread “Alder Lake-S” engineering sample is not bottlenecking GeForce RTX 2080

On Geekbench (which appears to be an epicenter of all leaks) there is a new sample of Alder Lake-S CPU with 8 cores and 16 threads. This configuration hasn’t really been seen that much. The reason why this is interesting is that it’s a ‘pure’ BIG core implementation.

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Moving on to the most interesting part of this leak. The CPU was paired with NVIDIA GeForce RTX 2080 graphics card and tested in OpenCL benchmark. While this synthetic benchmark is definitely not the best indicator of gaming performance, it certainly can be compared to existing results to draw some conclusions.

Alder Lake-S score

Intel-Alder-Lake-Performance-Geekbench-OpenCL-768x323.png


The official OpenCL ranking page has an average score of 106101 points for GeForce RTX 2080, which means that this particular sample not only does not bottleneck the GPU but it is also marginally faster. The reason why this is important is that we are probably looking at a very early engineering sample (either ES1 or ES2). Intel is not expected to ship qualification samples (QS) until at least summer this year.
https://videocardz.com/newz/early-i...-sample-is-not-bottlenecking-geforce-rtx-2080
 
Segmentação dos Alder Lake Mobile:
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https://videocardz.com/newz/intel-12th-gen-core-alder-lake-mobile-lineup-has-been-leaked

O primeiro numero são os Big Cores, depois os Little Cores e no fim o numero de EUs do GPU.
A nível de Codenames de cada Chip, o "Alder Lake M" irá estar nos TDPs de 5 e 9W, o "Alder Lake P" nos 15, 28 e 45W e o "Alder Lake S" nos 45 e 55W.

O "Alder Lake M", pelo menos o de 5W, parece semelhante ao "Lakefield". Talvez seja o sucessor. O "Alder Lake S" com 32 EUs, deve ser igual ou muito parecido à versão Desktop.
 
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https://videocardz.com/newz/exclusive-intel-12th-gen-core-alder-lake-s-platform-detailed

Ora, o que temos aqui:
  • +20% IPC (Não se sabe se a comparação é feita em relação ao Rocket Lake ou Tiger Lake). Penso que seja o Rocket.
  • Boards High End Z670 terão suporte DDR5-4800. Versões mais baratas (Da Z670 ou nos outros chipsets?), terão DDR4.
  • O CPU terá 16 Lanes Pci-Ex Gen5 e 4 Lanes Pci-Ex Gen4.
  • A ligação entre o CPU e o Chipset, DMI, passará para Gen4, com 8 Lanes.
  • Pci-Ex Gen4 e 3 no Chipset (Tem um * à frente deles).
  • O formato físico do Socket irá mudar. Sistemas de coolcing para LGA 115X e 1200 não serão compatíveis.
  • integrado Wi-Fi 6E e Thunderbolt4/USB4 no Chipset.
 
Um aumento de IPC maior num ano, do que em meia década, a partir dos Skylakes.
As maravilhas que a concorrência da AMD e ARM fazem.
 
Um aumento de IPC maior num ano, do que em meia década, a partir dos Skylakes.
As maravilhas que a concorrência da AMD e ARM fazem.

É pior que isso.

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https://www.anandtech.com/show/9483/intel-skylake-review-6700k-6600k-ddr4-ddr3-ipc-6th-generation/9

Entre o Sandy Bridge de 2011 e o Comet Lake actual, tens um aumento de IPC que andará à volta de 26%. No espaço de 10 anos, um aumento de menos de 30%.
Do Comet Lake para o Alder Lake (2 Gerações), aparentemente, irá ter-se um aumento de IPC acima de 35%, apesar do Rocket Lake, pelo meio, ser um port.

Para melhorar, a partir do momento que a AMD "acordou", o numero de Cores nos múltiplos SKUs da Intel, "estranhamente", disparou. De 4 para 10 em Desktop e de 2 para 6 em Mobile. Deixaram de fazer tanta segmentação com SMT,Turbos, desligar instruções AVX, AES, entre outros.

Para ser justos, o Sunny e Willow Cove a 10 nm, deviam estar prontos há muito tempo e até havia aquele refresh do Skylake a 10 nm, que a Intel só lançou 1 SKU, para não terem problemas com os Investidores.
A nível de arquitectura, as coisas nunca tiveram negras do lado da Intel. Os 10 nm é que foram um enorme desastre.

Estranho e sempre o chipset ter "features" do CPU como suporte de memoria...

Estranho? A Intel tem que fazer o seu elevado nível de segmentação de alguma forma. :D

Verdade seja dita, na parte do DDR5, como será algo muito recente e que se calhar terá preços bem elevados, talvez faça sentido ter essa segmentação para o High-End. :)
 
USB 2 não é legacy...

Há coisas que nunca irão precisar nem de perto a BW do USB 3 como teclados, ratos, impressoras... Então pode deixar muito bem 2/4 portas para isso que ajuda a baixar custos.

O que devia começar a ter mais é portas type-c, 2 em mid end e 4 em high end, mantendo pelo menos 6 portas USB type-A
 
O que devia começar a ter mais é portas type-c, 2 em mid end e 4 em high end, mantendo pelo menos 6 portas USB type-A

O Conector é melhor, mas o problema maior são os cabos. O utilizador precisa de saber que funcionalidades o Computador e dispositivo suportam e também precisa de saber se o cabo que tem ou vão comprar, suporta essas funcionalidades.
Além disso, já tive mais que uma vez, com dispositivos diferentes, problemas bizarros com cabos USB-C. Cabos dos fabricantes e que vêm com o próprio dispositivo. Marcas conhecidas. Coisas como certas funcionalidades funcionarem se as 2 pontas ficarem de uma maneira e dar timeouts 100% das vezes, se trocar as pontas do cabo, entre os 2 dispositivos.
Depois, sem ser utilizadores Apple :D, a maior parte das pessoas não gosta de dongles e conversores. Há uma infinidade de dispositivos actuais e do passado a usar USB-A.
Por ultimo, o "recente" branding USB também não ajuda. Aquela "coisa" do 2x1, 2x2, etc, é infeliz.
 
Alegadamente, info de um ES do Alder Lake:
xfJFZXr.jpg


https://www.igorslab.de/en/exclusive-data-to-intel-alder-lake-s-hot-fight-with-amd/

Se estou a perceber bem, TDP de 125W @ 1.8 Ghz, PL1 125W @ ???, PL2 228W @ 4.6 Ghz. Turbo @ 4.6 Ghz até 2 Big Cores, 4.4 Ghz até 4, 4.2 Ghz até 6 e 4 Ghz até 8 Big Cores.
Os Little Cores também parecem ter um Clock base de 1.8 Ghz, mas o Turbo vai a 3.4 Ghz até 4 Cores e 3 Ghz até 8 Cores.
O Socket chama-se Socket V. O Stepping deste ES é o B0.

Duas coisas que me parecem estranhas, ou está-me a escapar algo. PL1 tem o mesmo TDP do Clock Base? Pensei que seria maior. Além disso, 1.315V não é um valor muito elevado @ 4.2 Ghz?

Seja como for, isto é um ES e os valores podem mudar. :)
 
Será que está a ler os dados correctamente?

É que com núcleos assimétricos, cada tipo vai ter a sua velocidade, PL1, PL2 e TAU.
De certeza que os PL1 e 2, vão ser bem mais baixos nos Atom, para manter os consumos baixos.
Os Core, de certeza que vão ter valores mais elevados.

Aqueles 125W deve ser o consumo para os Core. Mas claro, a velocidade vai depender da carga sobre o CPU.
Um programa pesado com AVX que estoura os 125W, vai ter clocks mais baixos para manter os 125W.

Mais voltagem não é mau, a conta tem de ser feita sempre com a corrente e resistência do condutor.
Por exemplo, a energia que aquece um condutor, é descrita assim:
P=R*I^2

Mesmo a energia de um sistema eléctrico é com a P=I*V
 
Será que está a ler os dados correctamente?
É possível. Aqueles screenshot parece-me retirado do AIDA64. Mesmo se os valores estiverem correctos, é um ES, o que não "garante" nada. Se fosse um QS, seria outra história. Estes valores servem mais como um indicativo.
É que com núcleos assimétricos, cada tipo vai ter a sua velocidade, PL1, PL2 e TAU.
De certeza que os PL1 e 2, vão ser bem mais baixos nos Atom, para manter os consumos baixos.
Os Core, de certeza que vão ter valores mais elevados.
Certo, mas isso está espelhado, em parte, naquele report. O Turbo máximo dos Big Cores, que será o PL2 dos Big Cores, é 4.6 Ghz. Nos Little Cores, o Turbo Máximo, que será o seu PL2, é de 3.4 Ghz.
No Clock Base, não há ali divisão entre Big e Little Cores, por isso parto do principio que o Clock Base nos dois é de 1.8 Ghz, neste ES.

O que não percebo é o PL1 ter o mesmo TDP do TDP Base. Tinha ideia que normalmente, o PL1 é mais elevado que o TDP Base.
Aqueles 125W deve ser o consumo para os Core. Mas claro, a velocidade vai depender da carga sobre o CPU.
Penso que até aos dias de hoje, a Intel mede o TDP com Load em todos os Cores ao Clock Base. Agora com Big.Little não sei se isso será alterado. Por exemplo, se será só com Load nos Big Cores ou se não será medido no Clock Base, ou algo assim.
Um programa pesado com AVX que estoura os 125W, vai ter clocks mais baixos para manter os 125W.
Antes demais é preciso ver que este Alder Lake não terá suporte para AVX512.
Em Load com AVX2 é possível que os Clocks baixem, mas é interessante que naquele report, o Turbo reportado com AVX2 é exactamente igual ao Turbo "normal", pelo menos nos Big Cores.
 
1.8 Ghz parece-me demasiado baixo para Clock base num Core.
Seria de esperar algo a rondar os 3.5 Ghz.

O consumo de um CPU depende do programa que está a correr nele.
Um programa que seja fácil de organizar para o OoO, que encha todas os estágios do pipeline, vai gastar mais energia do que um programa que deixa algumas unidades por usar.
Ainda por cima, numa era onde a maioria das unidades de um CPU são clock gated.
 

Intel "Alder Lake" Memory Controller Could Carry Forward Gear Ratios


Intel's 12th generation Core "Alder Lake" desktop processors could take the concept of memory frequency "gear ratios" forward, according to patch notes from the most recent update to HWInfo64, as reported by Tom's Hardware. Introduced with 11th Gen Rocket Lake, a "gear" ratio is the ratio of the memory clock speed in relation to the memory controller speed. In Gear 1 (or 1:1), the two operate at the same frequency. In Gear 2, the ratio is 1:2 or the memory controller operates at half the frequency of the memory, enabling higher memory overclocking headroom. With "Alder Lake," the company could carry forward this concept for both DDR4 and DDR5 memory types that the controller supports. At this point we don't know if there are just two ratios (Gear 1 and 2), or whether the company could add some more granularity.

Isto pode abrir algumas possibilidades interessantes com OC das memórias....
 
Segundo uma lista que colocaste acima na página, Alder Lake P é suposto ser Mobile, mas também há 2 com essa combinação de cores e com TDP distintos, U28 e H45... ☹️
 
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